tinyriscv---一个从零开始写的极简、非常易懂的RISC-V处理器核

2019-12-06 19:17:47
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本项目实现的是一个微riscv处理器核(tinyriscv),用verilog语言编写,只求以最简单、最通俗易懂的方式实现riscv指令的功能。tinyriscv处理器核有以下特点:

1)实现了RV32I指令集,通过riscv的RV32I指令兼容性测试,支持以下指令:add addi and andi auipc beq bge bgeu blt bltu bne fence_i jal jalr lb lbu lh lhu lw lui or ori sb sh sw sll slli slt slti sltiu sltu sra srai srl srli sub xor xori;

2)采用三级流水线,即取指,译码、访存、执行,回写;

3)可以运行简单的c语言程序;


源码:https://gitee.com/liangkangnan/tinyriscv

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