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在 Verilog TestBench 中运行测试用例

开源蜂鸟E203 作者 Kaysar 发布于 2020-11-02 04:42（2188 天前） 54775 浏览

RICS-V

我正在尝试ubuntu中测试RlSC-V 处理嚣书中所提供的方法。

操作如下:

git clone https://github.com/SI-RISCV/e200_opensource.git

cd <your_e200_dir>/vsim

make install CORE=e203

make compile

下一步 make run_test 中出现了问题。报错如下图:

我是linux新手，希望能得到帮助成功编译。

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D

DarcyL606 天前 · 31 楼

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温温688 天前 · 32 楼

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水

水果有点甜721 天前 · 33 楼

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🏹760 天前 · 34 楼

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jwcx771 天前 · 35 楼

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唐shuai982 天前 · 36 楼

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天

天空是蓝色的1050 天前 · 37 楼

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Kaysar

Kaysar1077 天前 · 38 楼

回复 nn爱学习：

你解决了吗，我也有

解决了、不过几年前的事情了。

你编辑一下执行的文件。在指令里去掉 &。

如果想用tee 来记录屏幕信息、那么直接在｜后面写就可以。不需要 &。

& 是为了在后台执行命令。

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n

nn爱学习1077 天前 · 39 楼

你解决了吗，我也有

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n

nn爱学习1077 天前 · 40 楼

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aigoren1079 天前 · 41 楼

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heyh1140 天前 · 45 楼

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发布2020-11-02 04:42

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